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AT86RF231
Figure 11-9. High Data Rate AACK Timing
0
192
512
544
704
916
time [μs]
AACK_ACK_TIME = 0
AACK_ACK_TIME = 1
PSDU: 80 octets
PSDU: 80 octets
192 μs
ACK
ACK
32 μs
If register bit AACK_ACK_TIME (register 0x17, XAH_CTRL_1) is set the acknowledgment time
is reduced from 192 μs to 32 μs.
11.3.6
Register Description
Register 0x0C (TRX_CTRL_2):
The TRX_CTRL_2 register controls the data rate setting
Bit
7
6
5
4
3
2
1
0
+0x0C
RX_SAFE_MODE
Reserved
OQPSK_DATA_RATE
TRX_CTRL_2
Read/Write
Reset Value
R/W
0
R
0
R
0
R
0
R
0
R
0
R/W
0
R/W
0
? Bit 7 - RX_SAFE_MODE
Refer to Section 11.8.2 “Register Description” on page 154 .
? Bit [6:2] - Reserved
? Bit [1:0] - OQPSK_DATA_RATE
A write access to these register bits sets the OQPSK PSDU data rate used by the radio trans-
ceiver. The reset value OQPSK_DATA_RATE = 0 is the PSDU data rate according to
IEEE 802.15.4.
Table 11-9.
OQPSK Data Rate
Register Bits
OQPSK_DATA_RATE
Value
0
1
2
3
OQPSK Data Rate
250 kb/s
500 kb/s
1000 kb/s
2000 kb/s
Comment
IEEE 802.15.4 compliant
140
8111C–MCU Wireless–09/09
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